數(shù)字電路與邏輯設計

定　價：￥35.00

作　者：	蔣萬君編
出版社：	西南交通大學出版社
叢編項：	普通高等教育“十三五”規(guī)劃教材
標　簽：	暫缺

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ISBN：	9787564367435	出版時間：	2019-01-01	包裝：	平裝
開本：	16開	頁數(shù)：	175	字數(shù)：

內(nèi)容簡介

　　《數(shù)字電路與邏輯設計》從應用角度出發(fā)，在保持數(shù)字電路教材經(jīng)典內(nèi)容的基礎上增加VHDL語言程序設計。主要內(nèi)容有：邏輯代數(shù)基礎與信息表示、半導體集成門電路、組合邏輯電路、時序邏輯電路、脈沖波形的產(chǎn)生與整形、D/A與A/D轉(zhuǎn)換、半導體存儲器與可編程邏輯器件、硬件描述語言VHDL等。該書以獨特的視角，采用“提出問題、邏輯抽象、推導演繹”的方法展開講述，以區(qū)別于其他教材。特別是在各章節(jié)中插入的“說明”具有概括和提升作用，“閱讀材料”具有拓展視野和加深理解的作用。該書力圖克服知識的簡單堆砌，注重學科方法論的灌輸，提出的一些方法是其他教材沒有的?？紤]到數(shù)字電路后續(xù)的重要課程有單片機技術(shù)，所以有些理論結(jié)合單片機原理進行分析，為后續(xù)學習單片機技術(shù)做一定的鋪墊?！稊?shù)字電路與邏輯設計》精煉實用、深入淺出，插圖規(guī)范美觀，章節(jié)布局合理，系統(tǒng)完善，可作為電子類、電氣類、計算機類等專業(yè)的本科教材。

作者簡介

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圖書目錄

第1章邏輯代數(shù)基礎與信息表示
1．1 概述
1．1．1 模擬信號與數(shù)字信號
1．1．2 進制轉(zhuǎn)換
1．1．3 數(shù)字系統(tǒng)中信息的表示
1．2 邏輯代數(shù)中的基本運算及公式
1．2．1 邏輯函數(shù)
1．2．2 基本運算及公式
1．2．3 常用公式及定理
1．2．4 邏輯真值表轉(zhuǎn)換為邏輯函數(shù)
1．3 邏輯函數(shù)的標準式及化簡
1．3．1 邏輯函數(shù)的標準式
1．3．2 邏輯函數(shù)的卡諾圖表示
1．3．3 邏輯函數(shù)的公式化簡
1．3．4 邏輯函數(shù)的卡諾圖化簡
1．3．5 多輸出邏輯函數(shù)的化簡
習題
第2章半導體集成門電路
2．1 半導體開關(guān)元件
2．1．1 晶體二極管
2．1．2 晶體三極管
2．1．3 MOS管
2．2 TTL集成門電路
2．2．1 TTL非門
2．2．2 常見TTL門電路
2．3 CMOS集成門電路
2．3．1 CMOS非門
2．3．2 常見CMOS門電路
2．4 集成門電路的連接+
2．4．1 TTL門電路的帶負載能力
2．4．2 TTL電路與CMOS電路的連接和比較
習題
第3章組合邏輯電路
3．1 組合邏輯電路的分析與設計
3．1．1 組合邏輯電路的分析
3．1．2 組合邏輯電路的設計
3．2 常用組合邏輯電路
3．2．1 優(yōu)先編碼器
3．2．2 譯碼器
3．2．3 數(shù)據(jù)選擇器
3．2．4 數(shù)據(jù)比較器
3．2．5 加法器
3．2．6 函數(shù)發(fā)生器
3．2．7 奇偶校驗電路
3．3 用MSI芯片設計組合邏輯電路
3．3．1 用譯碼器設計組合邏輯電路
3．3．2 用數(shù)據(jù)選擇器設計組合邏輯電路
3．4 組合邏輯電路中的競爭與險象
3．4．1 競爭與險象的成因
3．4．2 消除競爭與險象的方法
習題
第4章時序邏輯電路
4．1 存儲元件——觸發(fā)器
4．1．1 RS觸發(fā)器及時鐘電平控制的觸發(fā)器
4．1．2 時鐘邊沿控制的觸發(fā)器
4．1．3 各類觸發(fā)器的替換
4．2 同步時序邏輯電路
4．2．1 同步時序邏輯電路的分析
4．2．2 寄存器
4．2．3 計數(shù)器
4．2．4 節(jié)拍發(fā)生器
4．3 異步時序邏輯電路
4．3．1 異步時序電路的分析
4．3．2 異步計數(shù)器
4．4 時序邏輯電路的設計
4．4．1 基于觸發(fā)器級的時序邏輯電路設計
4．4．2 基于芯片級的時序邏輯電路設計
習題
第5章脈沖波形的產(chǎn)生與整形
5．1 555時基電路
5．1．1 矩形脈沖的特性參數(shù)
……
第6章 D/A與A/D轉(zhuǎn)換
第7章半導體存儲器與可編程邏輯器件
第8章硬件描述語言VHDL
附錄
參考文獻