從算法設(shè)計(jì)到硬線邏輯的實(shí)現(xiàn)：實(shí)驗(yàn)練習(xí)與Verilog語(yǔ)法手冊(cè)

定　價(jià)：￥16.00

作　者：	夏宇聞編著
出版社：	高等教育出版社
叢編項(xiàng)：	實(shí)驗(yàn)練習(xí)與Verilog 語(yǔ)法手冊(cè)
標(biāo)　簽：	硬件描述語(yǔ)言 VHDL語(yǔ)言

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ISBN：	9787040092530	出版時(shí)間：	2001-06-18	包裝：	精裝
開本：	26cm	頁(yè)數(shù)：	164	字?jǐn)?shù)：

內(nèi)容簡(jiǎn)介

　　本書是《從算法設(shè)計(jì)到硬線邏輯的實(shí)現(xiàn)：復(fù)雜數(shù)字邏輯系統(tǒng)的VerilogHDL設(shè)計(jì)技術(shù)和方法》的配套用書。主要內(nèi)容包括12個(gè)實(shí)驗(yàn)練習(xí)和Verilog的語(yǔ)法手冊(cè)。各個(gè)實(shí)驗(yàn)由淺入深，從簡(jiǎn)單到復(fù)雜，介紹了用Verilog語(yǔ)言設(shè)計(jì)數(shù)字電路系統(tǒng)的實(shí)用方法與技術(shù)，有較強(qiáng)的實(shí)踐性和指導(dǎo)意義。語(yǔ)法部分包括標(biāo)志符的使用、基本語(yǔ)句以及系統(tǒng)任務(wù)和函數(shù)的介紹，內(nèi)容較為詳盡，可方便學(xué)生和工程技術(shù)人員查詢使用，對(duì)學(xué)習(xí)Verilog語(yǔ)言能起到很好的幫助作用。